07BR61R1 GJV3074376R1 寄存器

这种新方法存在一些问题。一个是我 初的互连 实现不理解当前活动从属的概念。任何从设备都可以响应 总线请求，而 互连 不会变得更明智。保持返回顺序意味着坚持内存访问是递增地址，并且从站在总线上根据它们 响应 请求所需的时间排序——因此响应快的从站总是在较低的地址。我通过在指令解码器中坚持认为任何内存操作字符串都指向相同地址或后续地址来处理这个问题
这种流水线内存方法的第二个问题涉及如何处理 总线 错误。一旦 CPU 可以发出请求而不等待它们的响应，那么 CPU 就可以在第一个返回总线错误之前发出多个操作 的 请求。虽然这使得在调试器中分析程序更具挑战性，但这种方法提供的速度优势确实非常巨大，而且通常超过任何缺点
结果是一个基本的流水线内存控制器。作为使用这种技术可以实现的性能的一个例子，ZipCPU可以在100MHz 总线运行时以 47MHz 切换输出引脚，而其他人测量运行 250MHz 总线的 Zynq 只能以 3.8 切换相同的引脚兆赫兹。在百分比方面， ZipCPU使用该技术能够展示 47% 的总线利用率，而 Zynq 的总线利用率为 1.5%
这种流水线内存 架构非常适用于 ZipCPU。可以轻松展开手动优化循环以获得的性能。然而，如果没有手动优化，这种技术的大好处是在生成或恢复堆栈帧时非常适合该技术

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